Ingénieur en Vérification UVM pour cible ASIC / FPGA / SOC F/H - Test, essai, validation, expertise (H/F) 06 - Vallauris
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Offre n° 8073105
Ingénieur en Vérification UVM pour cible ASIC / FPGA / SOC F/H - Test, essai, validation, expertise (H/F)
06 - Vallauris - Localiser avec Mappy
Publié le 20 janvier 2026
Descriptif du poste: Nous recherchons un ingénieur en microélectronique, justifiant d'une première expérience réussie en vérification au niveau IP ou system (top level) de SoC. Voici l'ensemble de vos responsabilités : * Capacité à rédiger et critiquer des plans de vérification précis et faciles à réutiliser. * Expertise avancée dans le développement de code réutilisable et scalable, avec une profonde maîtrise du System Verilog et une compétence avérée en méthodologie UVM. * Solide compétence dans la planification exhaustive et l'écriture précise de la couverture fonctionnelle ainsi que la couverture de code (coverage) pour assurer une vérification rigoureuse. * Maîtrise avancée des langages de script tels que Python, Perl, Tcl, démontrant la capacité à concevoir des scripts pour automatiser et optimiser les nouveaux flux de travail de vérification. * Familiarité approfondie avec les outils de pointe et les processus avancés liés au développement de bancs de tests, englobant tous les aspects du cycle de vérification (Siemens / Cadence / Synopsys) * Expérience significative avec les langages C/C++, attestant de la capacité à rédiger des tests de base en C pour renforcer la vérification système globale. * Communication facile pour échanger avec les autres membres de l'équipe et les autres métiers (design / DFT / backend) L'agence de rattachement de cette offre se situe à Valbonne-Sophia-Antipolis. Profil recherché: Ingénieur en micro-électronique de formation, vous justifiez d'une première expérience significative en Vérification de code RTL avec la méthodologie UVM. De plus vous avez déjà acquis les compétences suivantes : * Maîtrise étendue de la vérification de System-on-Chip (SoC) en utilisant la méthodologie UVM. * Expertise approfondie dans la conception et l'implémentation de tests dirigés en langage C, illustrant une polyvalence technique. * Excellente compétence dans l'utilisation de langages de programmation variés, tels que VHDL, Verilog/SystemVerilog, C embarqué, Specman. * Capacité à aborder les défis de la vérification de manière holistique, en adaptant les langages aux exigences spécifiques de chaque situation. * Aisance en anglais, aussi bien à l'oral qu'à l'écrit, facilitant une communication efficace au sein d'équipes internationales.
- Type de contrat
-
CDI
Contrat travail - Salaire
- 40 - 60 k€ brut annuel
Profil souhaité
Expérience
- 1 An(s)Cette expérience est indispensable
Informations complémentaires
- Qualification : Cadre
- Secteur d'activité : Ingénierie,études techniques
Employeur
elsys-design
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